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EPSON(爱普生)晶振

 

【技术专栏】晶振负载电容 C1/C2 选型三步法:一次把振荡幅度、起振时间和可靠性调到**状态

 

适用场景:石英晶体谐振器

不适用:MEMS 振荡器、有源晶振(它们内部已匹配)


基本原则


(1) 遵循制造商建议

每种晶振都有其独特的电气特性,因此,在选择外部元件时,务必参照制造厂商所提供的具体数值。这包括但不限于等效串联电阻(ESR)、推荐负载电容值、频率偏差等关键指标。


(2) C1, C2值尽量小

虽然较大的电容值有助于提高振荡器的稳定性,但它也会延长起振时间。因此,在不影响系统性能的前提下,应尽可能选择较小的C1和C2值。


(3) C2 > C1

为加快上电时的起振速度,建议使C2的值大于C1的值。这一设置能够有效减少初始启动时间,确保电路迅速进入稳定状态。


一、为什么必须自己算 C1/C2?


晶体数据手册给出的 "CL" 是"负载电容",不是外接电容。
板上实际看到的是 C1、C2、PCB 杂散 Cs(典型 2-5 pF)、芯片引脚 Ci/Co(1-3 pF)共同合成的结果。
公式记住一条即可:
CL = (C1 × C2)/(C1 + C2) + Cs
设计目标:让 "公式结果" 与厂家 CL 的误差 ≤ ±0.5 pF,频率误差即可控制在 ±10 ppm 级。

二、三步选型法(兼顾起振速度与波形)

步骤操作要点经验值为什么
① 查手册记录 CL、ESR、驱动功率CL=12 pF、ESR≤40 Ω(8 MHz 例)不同封装/频点差距很大,不要拍脑袋
② 初算 C1≈C2令 C1=C2=2×(CL-Cs)Cs 取 3 pF → C1=C2=18 pF先满足频率,再微调幅度
③ 按"C2>C1" 优化C2 比 C1 大 2-3 pFC1=15 pF,C2=18 pF上电时增益 margin 提升 5-8 %,起振时间缩短 10 % 以上
低功耗应用(MCU 休眠唤醒频繁)可把 C1/C2 整体再降 10 %,但须验证 -40 ℃ 低温启动。

三、现场调优:示波器这样看才准


  1. 探头选 100 MHz 以上、×10 档、输入电容 ≤12 pF(
    • (探头选择:为了获得最准确的测量结果,请使用带宽至少为100MHz的高阻抗示波器探头,因为这类探头对信号的影响最小。)

  2. 只测 OSCO 脚;OSCI 脚阻抗低,探头直插会停振
  3. 目标波形:纯正弦,Vpp ≥ 0.7×VDD
    • Vpp 过低 → 把 C1、C2 同时减小 2 pF
    • 波形削顶/畸变 → 增大 2-3 pF 或 串 10 Ω 阻尼电阻
    ( 调整电容:如果测得的波形峰峰值低于预期,则可以尝试减小OSCI(Input)和OSCO(Output)脚上的外接电容;反之,若波形接近饱和或出现失真现象,则适当增大电容值可能有所帮助)

四、一个 4 MHz 实例算给你看


  • 厂家参数:CL=15 pF,ESR=30 Ω
  • 预估 Cs=3 pF
  • 初值:C1=C2=2×(15-3)=24 pF
  • 取标称值:C1=22 pF,C2=27 pF(0805 NPO)
  • 实测:Vpp=2.1 V(VDD=3.3 V),起振时间 280 µs,-40 ℃ 仍正常启振 → 通过

五、元件 & PCB 小贴士


  1. 电容选 COG/NPO,温漂 ±30 ppm/℃,X7R 会跳频
  2. 晶体走线 <5 mm,包地、远离高频信号,下方完整 GND 层
  3. 若芯片带 "内部可调负载电容" 功能(部分 STM32、NRF52),可软件细调,省两颗外置电容

记住口诀:
"先手册,后公式;C2 略大,波形足;探头轻,地线短;低温也要起振酷!"
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